Intel 性能监视器之二
全文来自Intel开发者手册:Intel? 64 and IA-32 Architectures Software Developer’s Manual Volume 3B System Programming Guide.pdf
全文来自Intel开发者手册:Intel? 64 and IA-32 Architectures Software Developer’s Manual Volume 3B System Programming Guide.pdf
全文来自Intel手册:MultiProcessor Specification(http://download.intel.com/design/pentium/datashts/24201606.pdf)
Version 1.4
May 1997
注意:下文中已经指出手册中的对应页面和章节,请对照手册原文看,任何个人理解错误,请包涵。
一,以下内容来自(P25):3.6 Multiprocessor Interrupt Control
在多处理器系统上,中断通过APIC进行控制。下面将描述APIC架构和多处理器系统上的三种不同中断模型。
全文来自Intel手册(见参考1):Intel? 82093AA I/O Advanced Programmable Interrupt Controller (I/O APIC) Datasheet
注意:下文中已经指出手册中的对应页面和章节,请对照手册原文看,任何个人理解错误,请包涵。
一,以下内容来自(P9):3.2. IOAPIC Registers
1,IOAPIC标识寄存器
偏移:00h
默认值:00h
属性:可读/写
字段:27:24为IOAPIC标识
我是在处理一个网卡中断分发问题时看的这些内容,因为是外部中断到处理器的分发问题,因此我关注的重点是I/O APIC和外部设备中断,所以下面这部分内容以及接下来的两篇文章都是从手册里挑着看的。
全文来自Intel开发者手册:Intel? 64 and IA-32 Architectures Software Developer’s Manual Volume 3A System Programming Guide.pdf
注意:下文中已经指出手册中的对应页面和章节,请对照手册原文看,任何个人理解错误,请包涵。
全文来自Intel开发者手册:Intel? 64 and IA-32 Architectures Software Developer’s Manual Volume 3B System Programming Guide.pdf
被普遍引用得比较多的数据如下:
L1 cache reference 0.5 ns
Branch mispredict 5 ns
L2 cache reference 7 ns
Mutex lock/unlock 100 ns
Main memory reference 100 ns
Compress 1K bytes with Zippy 10,000 ns
Send 2K bytes over 1 Gbps network 20,000 ns
Read 1 MB sequentially from memory 250,000 ns
Round trip within same datacenter 500,000 ns
Disk seek 10,000,000 ns
Read 1 MB sequentially from network 10,000,000 ns
Read 1 MB sequentially from disk 30,000,000 ns
Send packet CA->Netherlands->CA 150,000,000 ns
上午9点到下午5点,今天收获比较小,当然这不是说intel的那几位讲师讲得不好,只是内容以嵌入式为主,而且太靠硬件了,而我现在既不开发嵌入式板子(虽然读研时学的是嵌入式方向)又不编写BIOS代码,所以大部分的关于各个内部的接口、引脚的连法、注意事项、vPro tools等这些我并不关心,也关心不上,不过总还是有收获的:
1,探讨一个平台主要从三方面着手:Cpu、Memory、Chipset。
2,AMT 8.0:这个是Active Management Technology的缩写,感觉对我现在的工作会有帮助,今天才初次了解一下,看了那讲师的现场演示,很先进,这技术有钱途,只是具体功能目前尚不太清楚,后续研究。
3,ME 8.0:我就知道全称为Management Engine,其它的,我真不知道!!!
没了,就上面这些。中午在酒店里闲逛了一下,高档货就是不一样,:)。
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内存,作为影响现代计算机性能至关重要的部件,最重要的指标有两个,分别是容量和带宽,而容量一般都很好理解,比如1G、2G,这也是大多数人对内存的最直观认识。更多关于内存的相关知识介绍,网上有一篇很好的文章“千丝万缕的联系 DDR1-3和GDDR1-5全解析”,所以这里也不打算多讲理论,还是来点更工程性的东西,或者说更实际点的。
Intel DPDK的相关介绍无需多说,能接触到它的人自然知道,无法接触到的人知道了也没用,目前从因特网下载不到源码,因为据说DPDK尚处于“Early Access”阶段,仅在签订NDA协议的前提下提供给相关企业客户使用,不过intel有计划未来进行大幅的广播该工具包(见intel官网帖子:http://embedded.communities.intel.com/thread/4935内MichaelLynch的回复,不过这已经是2011年3月份的事情),当然现在还是有很多企业已经在用,或尝试在用。用这个Kit制作的demo发包工具,同等条件下的性能比pktgen要好上一倍,当然,之前测试的pktgen模块未做任何优化,所以这种比较有点不公正,不过毕竟利用DPDK开发的程序都在应用层,所以测试与调试相对都会比较方便。